VerilogXiaYuwenExample

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夏宇闻程序夏宇闻 Verilog 夏宇闻 verilog example code

所属分类：VHDL/FPGA/Verilog
开发工具：VHDL
文件大小：538KB
下载次数：32
上传日期：2010-05-05 10:08:25

说明： Verilog数字系统设计教程（夏宇闻著）例题源程序
(Verilog Digital System Design Tutorial (Xia Yu smell) Example source code)

文件列表：

资料\ppt课件.rar
资料\上册例题\关于上册例题的说明.doc
资料\上册例题\第10章例题.doc
资料\上册例题\第11章例题.doc
资料\上册例题\第12章例题.doc
资料\上册例题\第13章例题.doc
资料\上册例题\第14章例题.doc
资料\上册例题\第15章例题.doc
资料\上册例题\第16章例题\I2Cdesign\addr.dat
资料\上册例题\第16章例题\I2Cdesign\data.dat
资料\上册例题\第16章例题\I2Cdesign\eeprom.v
资料\上册例题\第16章例题\I2Cdesign\eeprom_wr.v
资料\上册例题\第16章例题\I2Cdesign\signal.v
资料\上册例题\第16章例题\I2Cdesign\top.v
资料\上册例题\第16章例题\I2Cdesign
资料\上册例题\第16章例题
资料\上册例题\第16章例题.doc
资料\上册例题\第17章例题\RiscCpu\accum.v
资料\上册例题\第17章例题\RiscCpu\addr_decode.v
资料\上册例题\第17章例题\RiscCpu\adr.v
资料\上册例题\第17章例题\RiscCpu\alu.v
资料\上册例题\第17章例题\RiscCpu\clk_gen.v
资料\上册例题\第17章例题\RiscCpu\counter.v
资料\上册例题\第17章例题\RiscCpu\cpu.v
资料\上册例题\第17章例题\RiscCpu\cputop.v
资料\上册例题\第17章例题\RiscCpu\datactl.v
资料\上册例题\第17章例题\RiscCpu\machine.v
资料\上册例题\第17章例题\RiscCpu\machinectl.v
资料\上册例题\第17章例题\RiscCpu\ram.v
资料\上册例题\第17章例题\RiscCpu\register.v
资料\上册例题\第17章例题\RiscCpu\rom.v
资料\上册例题\第17章例题\RiscCpu\test1.dat
资料\上册例题\第17章例题\RiscCpu\test1.pro
资料\上册例题\第17章例题\RiscCpu\test2.dat
资料\上册例题\第17章例题\RiscCpu\test2.pro
资料\上册例题\第17章例题\RiscCpu\test3.dat
资料\上册例题\第17章例题\RiscCpu\test3.pro
资料\上册例题\第17章例题\RiscCpu
资料\上册例题\第17章例题
资料\上册例题\第18章例题.doc
资料\上册例题\第2章例题.doc
资料\上册例题\第4章例题.doc
资料\上册例题\第5章例题.doc
资料\上册例题\第6章例题.doc
资料\上册例题\第7章例题.doc
资料\上册例题\第8章例题.doc
资料\上册例题\第9章例题.doc
资料\上册例题
资料\下册例题\关于下册例题的说明.doc
资料\下册例题\练习1-9.doc
资料\下册例题\练习10.doc
资料\下册例题\练习11.doc
资料\下册例题\练习12.doc
资料\下册例题
资料

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